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待机功耗低的电路 (待机功耗英文缩写)

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基础定时器电路和控制逻辑一起可使V电源的功耗在待机状态下低至1μA。当输入信号使输出脉冲增高时,功耗会增加至6mA。电路可和CMOS逻辑接口。负向输入脉冲会触发SR触发器。:

标签: 待机功耗英文缩写


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